發(fā)布：2023-05-27 07:46:52 關(guān)注：14254次
人才引進(jìn)工作地區(qū)：北京
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集成電路學(xué)院丨招1人
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所需專(zhuān)業(yè)集成電路、電子、計(jì)算機(jī)等相關(guān)專(zhuān)業(yè) |
資質(zhì)要求職稱(chēng)資質(zhì)符合學(xué)校相關(guān)崗位系列要求 |
學(xué)習(xí)經(jīng)歷及工作經(jīng)歷滿(mǎn)足以下條件之一：
1、 學(xué)位要求本科及以上 并且 工作年限要求不限
核心職責(zé)及次要職責(zé)：
1、在指導(dǎo)下，完成功能模塊的設(shè)計(jì)開(kāi)發(fā)工作，包括RTL設(shè)計(jì)、RTL驗(yàn)證、形式驗(yàn)證、RTL綜合、時(shí)序驗(yàn)證、DFT/ATPG等工作，實(shí)現(xiàn)芯片功能、性能要求； 2、負(fù)責(zé)開(kāi)發(fā)過(guò)程中設(shè)計(jì)文檔的撰寫(xiě)和整理； 3、與其他軟件和硬件工程師協(xié)同工作。
其他要求：
特殊要求： 1、1、集成電路、電子、計(jì)算機(jī)等相關(guān)專(zhuān)業(yè)； 2、本科及以上學(xué)歷；按照學(xué)校對(duì)工程實(shí)驗(yàn)技術(shù)-試驗(yàn)發(fā)展系列的相關(guān)資質(zhì)要求執(zhí)行； 3、熟悉數(shù)字電路知識(shí)，了解半導(dǎo)體物理、半導(dǎo)體器件知識(shí)； 4、了解設(shè)計(jì)流程，熟悉硬件描述語(yǔ)言（如Verilog, VHDL）和電路仿真工具（如VCS、NC-Verilog、Modelsim等）； 5、熟悉至少一種腳本語(yǔ)言，perl、python、shell、TCL等，了解EDA工具（Synopsys/Cadence/ Mentor）。
聯(lián)系人及聯(lián)系方式：
聯(lián)系人：徐老師
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